Vous avez un produit à base de Xilinx? Voulez-vous en vedette sur l …


Xcell Daily propose souvent des produits basés sur Xilinx et souligne la façon dont les fonctionnalités uniques des périphériques Tous programmables de Xilinx ont permis des fonctionnalités innovantes de produit final. Beaucoup de ces Xcell Daily les articles de blog proviennent de vidéos du programme «Powered by Xilinx». Si vous possédez un produit génial basé sur un ou plusieurs périphériques Xilinx et souhaitez le voir présenté dans le programme «Powered by Xilinx», nous aimerions le savoir. Vous pouvez soumettre une demande pour être considéré pour ce programme ici.

Propulsé par Xilinx Logo.jpg



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Apprenez à accélérer vos applications en utilisant AW …


Le prochain forum des développeurs Xilinx, qui se tiendra le 9 janvier à Francfort, en Allemagne, comportera un laboratoire de développement pratique intitulé «Accélération des applications avec les FPGA sur AWS. ”Au cours de cette session de l'après-midi, vous acquerrez une expérience pratique précieuse avec l'instance AWS EC2 F1 accélérée par FPGA et vous entendrez par un orateur invité spécial d'Amazon Web Services. La participation est limitée selon le principe du premier arrivé, premier servi. Vous devez donc vous inscrire ici.

Pour plus d’informations sur l’instance AWS EC2 F1 d’Amazon dans Xcell Daily, voir:



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L'outil de programmation P4 en nuage génère du code pour …


NP4, un outil de programmation basé sur le cloud de Netcope, vous permet de spécifier le comportement du réseau à l'aide de déclarations écrites dans le langage de programmation de haut niveau, spécifique au réseau P4, pour les cartes réseau intelligentes programmables hautes performances de la société basées sur les FPGA Xilinx Virtex UltraScale et Virtex-7. . Le processus de programmation comprend les étapes suivantes:

  1. Écrivez le code P4.
  2. Téléchargez votre code sur le cloud NP4.
  3. Attendez que l'application traduise de manière autonome votre code P4 en VHDL et synthétise la configuration FPGA.
  4. Téléchargez le flux binaire du micrologiciel et chargez-le sur le FPGA de votre carte réseau Netcope.

Netcope appelle NP4 son offre «Firmware as a Service». Si vous souhaitez essayer NP4, vous pouvez demander un accès d'essai gratuit au service cloud ici.

NIC programmable Netcope NFB-200G2QL.jpg

Carte réseau intelligente Ethernet 200G NFB-200G2QL de Netcope Technologies basée sur un FPGA Virtex UltraScale

Pour plus d’informations sur Netcope et P4 dans Xcell Daily, voir:

Pour plus d’informations sur les cartes réseau basées sur FPGA de Netcope dans Xcell Daily, voir:



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Les Chroniques MicroZed d'Adam Taylor, Partie 227: Les …


Par Adam Taylor

Au cours des deux dernières semaines, nous avons examiné les moyens de déboguer nos conceptions à l’aide de la sonde μC / Probe (Post 1 et Post 2) de Micrium ou du pont JTAG vers AXI. Cependant, le meilleur moyen de minimiser le temps passé au débogage est de générer des conceptions de haute qualité. Nous pouvons ensuite nous concentrer sur la fonctionnalité de conception spécifiée au lieu de rechercher des bogues.

Pour améliorer la qualité de notre conception, nous pouvons procéder de différentes manières pour nous aider à respecter les délais impartis et à identifier les problèmes de conception et les bugs:

  1. Examinez le code pour vous assurer qu’il n’est pas seulement conforme aux normes de codage et de conception, mais aussi pour déceler les problèmes fonctionnels plus tôt dans la phase de conception.
  2. Assurez la conformité aux normes de codage recommandées pour les appareils / outils, par exemple la méthodologie de conception Xilinx Ultrafast.
  3. Contraindre correctement le dessin pour les horloges, les multicycle et les faux chemins.
  4. Analysez les CDC (Horloges de domaine) pour vous assurer que tous les CDC sont gérés correctement.
  5. Effectuer une simulation détaillée pour tester les cas de coins et les conditions aux limites.

Au cours de ma carrière, j'ai passé de nombreuses heures à réviser le code, à en vérifier la fonctionnalité et la conformité aux normes de codage et aux recommandations relatives à la chaîne d'outils.

Blue Pearl Visual Verification Suite est un outil EDA qui automatise la vérification de la conception sur une gamme d'ensembles de règles personnalisables, notamment les règles de base, les règles de méthodologie de conception Xilinx Ultrafast et DO254. Les outils Blue Pearl effectuent également une analyse détaillée des horloges, des compteurs, des machines à états, des CDC, des chemins et des contraintes. Toutes ces vérifications aident les ingénieurs à mieux comprendre le côté fonctionnel de leur conception. En bref, c’est un ensemble d’outils très utile à avoir dans notre boîte à outils pour améliorer la qualité de la conception. Voyons comment cet outil s’intègre à l’environnement de conception de Xilinx Vivado et comment nous pouvons l’utiliser dans une conception simple.

Avec Blue Pearl installé, la première étape consiste à l’intégrer à Vivado. Pour ce faire, nous utilisons Xilinx TCL Store pour installer la suite de vérification visuelle Blue Pearl.

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Installation de Blue Pearl via le magasin Xilinx TCL

Une fois Blue Pearl installé, vous devez créer deux commandes personnalisées. La première commande nous permet d’ouvrir un nouveau projet Blue Pearl à partir d’un projet ouvert Vivado. La deuxième commande permet les mises à jour de Vivado dans le projet Blue Pearl.

Nous créons ces commandes personnalisées en sélectionnant outils-> commandes personnalisées-> commandes personnalisées.

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Ouvrir la boîte de dialogue Personnalisation de la commande

Cela ouvre une boîte de dialogue qui vous permet de créer des commandes personnalisées. Pour chaque commande, nous devons définir les procédures TCL appelables dans la suite de vérification visuelle Blue Pearl.

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Création de la commande Launch BPS

Pour la commande "launch BPS", nous devons utiliser la commande:

:: tclapp :: bluepearl :: bpsvvs :: launch_bps

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Création de la commande de mise à jour

Pour la commande update BPS, nous appelons la commande suivante:

:: tclapp :: bluepearl :: bpsvvs :: update_vivado_into_bps

Une fois que vous avez terminé l’ajout des commandes personnalisées, vous verrez deux nouveaux boutons dans la barre d’outils Vivado.

Une fois l'intégration terminée, nous pouvons maintenant utiliser Blue Pearl pour analyser et améliorer la qualité de notre conception si nous identifions des problèmes nécessitant une analyse. En cliquant sur la commande «Lancer Blue Pearl» récemment créée dans un projet Vivado, vous ouvrez un nouveau projet Blue Pearl à des fins d'analyse.

En chargeant le design Vivado, Blue Pearl vérifie la synthèse du code et identifie les cases noires. Toute erreur de syntaxe rencontrée sera signalée pour correction avant toute analyse ultérieure.

Un grand nombre de contrôles et d'analyses peuvent être effectués sur la conception chargée, allant des contrôles de base à la conformité à la norme DO254. Il y a tellement d'éléments de liste de contrôle possibles que la sélection des contrôles importants pour vous peut prendre un peu de temps. Cependant, une fois que vous avez spécifié les vérifications souhaitées, vous pouvez enregistrer les règles et les utiliser dans plusieurs projets. Ce qui est intéressant, c’est que l’outil indique également si la vérification a été effectuée et pas seulement son statut de réussite ou d’échec. Ce mécanisme de retour explicite empêche les concepteurs d’obtenir la conformité par omission. (Et c’est une bonne chose.)

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Blue Pearl Environment

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Configuration du contrôle de conception

Par exemple, j'ai chargé un projet sur lequel je travaille pour voir à quoi ressemblent les rapports de vérification de la conception et d'analyse. Le design est simple. Il décode un flux MIPI pour créer des valeurs de synchronisation de trame, de synchronisation de ligne et de pixel. Bien qu'il s'agisse d'une conception simple, Blue Pearl a tout de même identifié quelques problèmes dans le code qui doivent être pris en compte pour déterminer s'ils présentent un problème ou non.

Le premier problème potentiel identifié a été l'analyse If / Then / Else (ITE). La conception contient un processus VHDL qui décode le type d’en-tête MIPI. Ce processus est écrit en utilisant une structure if / elsif, ce qui implique un codeur de priorité. De plus, pour différencier cinq commandes d'en-tête différentes, la longueur du codeur de priorité contient une structure de cinq profondeurs if / elsif. Blue Pearl appelle cela une longueur de cinq. Par défaut, Blue Pearl génère des avertissements sur des longueurs supérieures à 3. Dans ce cas, aucune priorité n'est requise et une instruction case fournira de meilleurs résultats de synthèse car il n'est pas nécessaire de prendre en compte la priorité d'entrée. Bien que chaque application soit différente, en tant qu’ingénieur, vous devez utiliser votre propre expérience et votre connaissance de la conception pour décider si une priorité est nécessaire ou non.

En plus d'indiquer la longueur de la structure if, l'analyse ITE analyse également le nombre de conditions contenues dans une déclaration. Cela est important lorsqu'une instruction if contient plusieurs conditions car des conditions supplémentaires nécessitent des ressources logiques et un routage supplémentaires, ce qui aura une incidence sur nos performances de synchronisation.

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Identification de si / alors / autre grande longueur

Les machines à états sont bien sûr utilisées dans les conceptions de structures de contrôle. Les structures de contrôle complexes nécessitent de grandes machines à états, ce qui peut être difficile à suivre dans la RTL. Dans le cadre de son analyse, Blue Pearl crée des visualisations de machines à états dans une conception. Cette visualisation détaille les transitions entre les états et identifie les états inaccessibles. J'ai trouvé cette fonctionnalité très utile non seulement pour le débogage et la vérification du comportement de mes propres machines d'état, mais également pour la visualisation de conceptions tierces. Cette capacité graphique m'aide certainement à comprendre l'intention du concepteur.

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Visualiseur d'analyse FSM

Blue Pearl offre également la possibilité de visualiser les CDC et les chemins et de surveiller les ventilations dans une conception. Ces fonctionnalités nous permettent d'identifier dans la conception des endroits où nous pourrions ajouter des mesures d'atténuation des CDC, telles que le recalage ou des registres de pipeline dans la conception.

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Analyse de croisement de domaine d'horloge

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Analyse de chemin

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Flip-Flop Fan sur les rapports

Après avoir évoqué légèrement les capacités de Blue Pearl, je suis impressionné par les résultats obtenus une fois que vous avez pris le temps de définir les contrôles et analyses appropriés. L'analyse fournie vous permet d'identifier les problèmes potentiels plus tôt dans le cycle de conception, ce qui devrait réduire le temps passé à rechercher les bogues dans le laboratoire. Cela nous permet de consacrer davantage de temps à la fonctionnalité de test.

Vous pouvez trouver l'exemple de code source sur GitHub.

Le site Web d’Adam Taylor est http://adiuvoengineering.com/.

Si vous voulez des versions e-book ou reliées des précédents blogs de chroniques MicroZed, vous pouvez les obtenir ci-dessous.

Première année E Book here

Première année Hardback ici.

MicroZed Chronicles hardcopy.jpg

Deuxième année E Book here

Deuxième année relié ici

MicroZed Chronicles Second Year.jpg



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Forbes.com publie un rapport de statut sur Amazon AWS …


L'article de Karl Freund intitulé «Amazon AWS et Xilinx: rapport d'étape”Est ​​apparu sur Forbes.com aujourd'hui. Freund est un analyste principal de Moor Insights & Strategy pour l'apprentissage en profondeur et l'informatique haute performance (HPC). Il décrit l’instance AWS EC2 F1 d’Amazon proposée par Amazon:

“… Le leader du cloud [Amazon] pose les bases pour simplifier l'adoption des FPGA en créant un marché pour les applications accélérées basées sur Xilinx [Virtex UltraScale+] FPGA. ”

Freund discute ensuite de ce qui s’est passé depuis qu’Amazon a annoncé son instance AWS EC2 F1 il ya un an. Voici ses sept faits saillants:

  1. "AWS a déployé les instances F1 dans quatre régions, et d'autres sont à venir …"
  2. "Pour prendre en charge les marchés asiatiques, où AWS a une présence limitée, Xilinx a su gagner le soutien des opérations de cloud Alibaba et Huawei."
  3. «Xilinx a lancé un programme mondial de sensibilisation des développeurs et a déjà formé plus de 1 000 développeurs. [on the use of AWS EC2 F1] sur trois forums de développement Xilinx, avec d’autres à venir.
  4. «Xilinx a récemment publié une instance AMI (Amazon Machine Instance) d’apprentissage machine (ML), intégrant la pile d’accélération reconfigurable Xilinx (annoncée l’année dernière) pour ML Inference vers le cloud AWS.»
  5. «Edico Genome, partenaire de Xilinx, a récemment réalisé un record mondial Guinness pour le décodage de génomes humains, analysant 1000 génomes humains complets sur 1000 instances F1 en 2 heures et 25 minutes; une amélioration remarquable de 100 fois de la performance… ”
  6. «AWS a ajouté la prise en charge de l'environnement de programmation Xilinx SDAccel à toutes les régions AWS pour les développeurs de solutions…»
  7. «Ryft, partenaire de Xilinx, a construit une plateforme analytique impressionnante sur la F1, permettant une analyse en temps quasi réel en éliminant les goulots d'étranglement dans la préparation des données…»

La suite de l’article de Freund traite plus en détail de l’offre AWS Marketplace de Ryft et se termine comme suit:

“… Au moins pour le moment, Amazon.com, Huawei, Alibaba, Baidu et Tencent ont tous voté pour Xilinx.”

Pour les vastes Xcell Daily la couverture de l'instance AWS EC2 F1, voir:



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L'application de numérisation de fichiers RegEx Hyperion F1 10G …


Le dernier ajout de Titan IC à AWS Marketplace, basé sur l'instance AWS EC2 F1 accélérée par le FPGA, est l'analyse de fichier RegEx Hyperion F1 10G, une application hautes performances de recherche et d'analyse de fichiers capable de traiter 1 To de données avec jusqu'à 800 000 expressions régulières définies par l'utilisateur en moins de 15 minutes. L’analyse de fichier RegEx Hyperion F1 10G exploite la puissance de traitement des multiples FPGA Xilinx Virtex UltraScale + VU9P de l’instance AWS EC2 F1 pour accélérer l’analyse des fichiers à l’aide de modèles et de correspondances de chaînes complexes, atteignant un débit atteignant 10 Gbps.

Voici un diagramme montrant l'application de numérisation de fichier RegEx Hyperion F1 10G s'exécutant dans une instance AWS EC2 f1.2xlarge:

Titan IC Hyperion F1 10G Analyse de fichier RegEx sur AWS EC2 F1.jpg

Vous pouvez obtenir plus de détails sur cette application ici dans AWS Marketplace.

Pour plus d’informations sur l’instance AWS EC2 F1 d’Amazon dans Xcell Daily, voir:



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Quel est le secret pour obtenir de véritables Ethern à 200 Gbps?


Quand Xcell Daily La dernière fois que nous avons examiné la carte réseau Ethernet intelligente 200G basée sur le FPG NFB-200G2QL de Netcope Technologies en août, avec son dissipateur de chaleur NASA-scoop, elle avait battu des records de performances en matière de performances 100GbE avec un débit de 148,8 millions de paquets / sec sur DPDK (le plan de données). Kit de développement) – le maximum théorique pour les paquets de 64 octets de plus de 100GbE. (Voir “Netcope bat un record de 100 GbE avec 148,8 millions de paquets / s (le maximum théorique) avec la carte réseau NFB-100G2Q basée sur FPGA, puis passe plus rapidement à 200 GbE.) À l’époque, tout ce que Netcope disait était que la carte PCIe NFB-200G2QL était «basée sur un Xilinx Virtex UltraScale + FPGA». Eh bien, Netcope était à la SC17 à Denver plus tôt ce mois-ci et étend les capacités de la carte. . Il est maintenant capable d’envoyer ou de recevoir des paquets à un débit de 200 Gbit / s sans perte de paquets, en utilisant toujours «la dernière puce FPGA Xilinx, Virtex UltraScale +», qui m’a été présentée sur le stand SC17 de Netcope est un FPGA Xilinx Virtex UltraScale +.

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Carte réseau intelligente Ethernet 200G NFB-200G2QL de Netcope Technologies basée sur un FPGA Virtex UltraScale

Une astuce consiste à utiliser deux emplacements PCIe Gen3 x16 pour acheminer des paquets vers / depuis le ou les processeurs du serveur. Pourquoi deux slots? Parce que Netcope a découvert que sa carte PCIe 200G Smart NIC pouvait transférer des paquets d’une valeur d’environ 110 Gbps sur un emplacement PCIe Gen3 x16 et que le débit de trafic maximal théorique pour un tel emplacement était de 128 Gbps. Cela signifie que 200 Gbps ne passeront pas à travers l'œil de cette aiguille à 1 fente. D'où la nécessité de deux emplacements PCIe, qui transporteront les paquets d'une valeur de 200 Gbps avec une marge confortable. D'où vient cette deuxième interface PCIe Gen3? Sur un câble relié à la carte Smart NIC et implémenté dans le même FPIL Xilinx Virtex UltraScale + VU7P, bien sûr. La société a rédigé un livre blanc décrivant cette technique et intitulé «Surmonter les limites de bande passante du PCI Express. "

Et oui, il y a une courte vidéo montrant aussi cette sorcellerie Netcope:



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Collection du semestre complet du professeur CMU …


Voici une vraie trouvaille, grâce à LinkedIn: un semestre complet de notes de cours du nouveau journal de Philip Koopman Génie logiciel pour systèmes embarqués classe de fin d'études à la CMU. C’est plus de 40 modules au format PDF en ligne qui regorgent d’informations!

Qu'est-ce que cela a à voir avec Xilinx? Quiconque écrit du code pour les multiples processeurs Arm Cortex dans les SoC Xilinx Zynq et les MPSo Zynq UltraScale ou pour les processeurs MicroBlaze intégrés instanciés dans des matrices FPGA Xilinx bénéficiera des informations contenues dans ces notes de cours. Je tiens à remercier le professeur Koopman d’avoir posté ces notes, puis l’URL sur LinkedIn.

Oh, il a aussi un livre intitulé "Meilleur logiciel système intégré, ”Que vous pouvez obtenir sur Amazon au prix de 66,05 $ ou sur le site Web du professeur Koopman pour 69,99 $ avec les frais de livraison inclus. (Le livre se vend à 140 $.)

Logiciel système intégré Book.jpg

Manuel du logiciel du système intégré TOC.jpg



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Spectrum Instrumentation construit une plate-forme PCIe pour …


Plus tôt ce mois-ci, Spectrum Instrumentation a annoncé les premiers membres d'une nouvelle série de numériseurs multicanaux haute vitesse basés sur sa nouvelle carte plate-forme PCIe M2p, elle-même basée sur un FPGA Xilinx Artix-7 A75T. Selon cette annonce, la carte de plate-forme M2p PCIe servira de base à tous les futurs produits de la société, y compris la série initiale de treize nouvelles cartes de numérisation M2p.59xx avec des vitesses de numérisation de 20, 40, 80 ou 125 millions d'échantillons / sec avec 1, 2, 4 ou 8 canaux d'entrée analogiques 16 bits (avec des CAN distincts pour chaque canal) utilisant un ou deux modules mezzanine dans la nouvelle famille de 59 modules de la société. Il existe également 1 Go de mémoire SDRAM intégrée capable de stocker 512 millions d’échantillons (plusieurs secondes de stockage en temps réel pour les signaux numérisés).

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La nouvelle famille de numériseurs à grande vitesse M2p.59xx de Spectrum Instrumentation est basée sur le FPGA Xilinx Artix-7

Cette conception modulaire crée immédiatement 20 nouveaux numériseurs dans la famille de produits. Une autre carte mezzanine appelée star-Hub vous permet de synchroniser jusqu'à 16 cartes de numérisation M2p.59xx. Oliver Rovini, CTO de Spectrum, a déclaré que «… les nouvelles unités remplaceront sans problème tous nos modèles 12, 14 et 16 bits actuels, offrant à nos clients existants une voie de mise à niveau facile avec de nombreux avantages techniques.» Plus de modèles basés sur le PCIe M2p La plate-forme sera annoncée l'année prochaine et pourrait inclure des générateurs de signaux arbitraires (AWG) et des cartes d'entrées / sorties numériques, en plus des numériseurs analogiques haute vitesse. Les applications cibles de la nouvelle famille de cartes de numérisation de Spectrum comprennent des expériences sur les ultrasons, le laser, le lidar, le radar, l’automobile et la physique.

Le FPGA intégré Artix-7 implémente l’interface PCIe Gen1 x4 de la carte M2p, les interfaces avec les cartes mezzanine et de multiples modes d’acquisition intelligents, notamment l’enregistrement multiple pour une acquisition segmentée, un échantillonnage synchronisé pour une acquisition temporelle et un mode ABA combinant enregistreur graphique et modes d’acquisition rapide. Le FPGA Artix-7 implémente également de multiples entrées de déclenchement, sorties de déclenchement, sorties d'état et entrées numériques synchrones, ainsi que l'horodatage des signaux numérisés.

L'utilisation d'un appareil tout programmable, en particulier du FPGA Artix-7, a permis à Spectrum de développer une plate-forme véritablement flexible pouvant répondre à pratiquement toutes les exigences des marchés cibles. Les E / S reprogrammables du périphérique prennent en charge une large gamme d’interfaces ADC et peuvent tout aussi bien gérer les DAC nécessaires à la création de modules mezzanine AWG. Il en va de même pour la mise en œuvre de l’interface PCIe x4 de la carte M2p. La logique programmable de l’appareil permet à la société de développer toutes sortes d’adresses de traitement et de contrôle IP adaptées à l’adaptation de la carte à un large éventail d’applications sans modifier la nomenclature.

Enfin, la nouvelle vidéo de la société sur cette gamme de produits (voir ci-dessous) indique que la société prend en charge ses produits en les entretenant et en les réparant pendant 15 ans après leur introduction. La prise en charge à long terme de Xilinx pour ses périphériques Tous programmables permet ce type de prise en charge des produits finis. Si vous analysez de près le libellé de l’annonce de Spectrum Instrumentation, la société a parié son avenir sur le FPGA Artix-7. Il faut une technologie de base puissante, flexible et fiable pour faire un pari comme celui-là.

Voici une vidéo de 4 minutes de Spectrum Instrumentation détaillant les caractéristiques de la nouvelle gamme de produits M2p.59xx:



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